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Load Diff
@ -1,6 +1,6 @@
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|
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|
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|
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|
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|
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@ -64,7 +64,9 @@
|
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33,
|
33,
|
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34,
|
34,
|
||||||
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|
35,
|
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36
|
36,
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39,
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40
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|
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|
"visible_layers": "fffffff_ffffffff",
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|
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@ -45,7 +45,6 @@
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|
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|
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|
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|
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@ -58,32 +57,43 @@
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
"duplicate_footprints": "warning",
|
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|
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|
||||||
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|
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|
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|
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|
"hole_clearance": "error",
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
"malformed_courtyard": "error",
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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@ -92,28 +102,70 @@
|
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|
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|
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|
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|
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|
"rule_severitieslegacy_courtyards_overlap": true,
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
"min_hole_clearance": 0.25,
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|
"min_hole_to_hole": 0.25,
|
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|
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|
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|
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"min_via_diameter": 0.39999999999999997,
|
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|
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"use_height_for_length_calcs": true
|
"use_height_for_length_calcs": true
|
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|
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|
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|
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|
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|
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|
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|
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|
||||||
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|
||||||
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|
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|
||||||
|
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|
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|
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|
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|
"teardrop_parameters": [
|
||||||
|
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|
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|
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|
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|
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|
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|
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|
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|
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"td_curve_segcount": 0,
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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|
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@ -439,7 +491,456 @@
|
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|
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|
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|
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|
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|
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|
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|
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|
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|
||||||
|
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|
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{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "CUSTOM_GPIO2"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "CUSTOM_GPIO34"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "ESP_RX"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "ESP_TX"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "GND"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(12V1-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(12V2-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Boot1-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(C10-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(C14-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(C16-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(C17-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(C4-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(C5-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(C6-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D10-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D11-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D12-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D13-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D14-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D15-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D16-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D4-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D5-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D7-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(D9-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Pumps1-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q1-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q1-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q10-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q11-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q12-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q12-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q13-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q13-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q2-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q2-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q3-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q3-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q4-Pad3)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q5-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q6-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q7-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q_PWR2-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q_PWR3-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q_PWR4-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
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"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q_PWR5-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(Q_PWR6-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(R1-Pad1)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(R14-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
"pattern": "Net-(R18-Pad2)"
|
||||||
|
},
|
||||||
|
{
|
||||||
|
"netclass": "Default",
|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
|
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|
||||||
|
},
|
||||||
|
{
|
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|
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|
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|
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|
||||||
|
},
|
||||||
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{
|
||||||
|
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|
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|
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|
||||||
|
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|
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{
|
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|
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|
||||||
|
},
|
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{
|
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|
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|
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|
||||||
|
},
|
||||||
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{
|
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|
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|
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|
||||||
|
},
|
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{
|
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|
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|
||||||
|
},
|
||||||
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{
|
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|
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|
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|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
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|
||||||
|
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|
||||||
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{
|
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|
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|
||||||
|
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|
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{
|
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|
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|
||||||
|
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|
||||||
|
{
|
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|
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|
||||||
|
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|
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{
|
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|
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|
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|
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|
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|
||||||
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{
|
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|
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|
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|
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|
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{
|
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|
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|
||||||
|
},
|
||||||
|
{
|
||||||
|
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|
||||||
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|
||||||
|
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|
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|
{
|
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|
||||||
|
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|
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{
|
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|
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|
||||||
|
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|
||||||
|
{
|
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|
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|
||||||
|
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|
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{
|
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|
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|
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{
|
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|
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|
||||||
|
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|
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|
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|
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|
||||||
|
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|
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|
{
|
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|
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|
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|
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|
||||||
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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|
{
|
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|
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|
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|
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|
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{
|
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|
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{
|
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|
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{
|
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|
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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|
{
|
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|
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|
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|
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|
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|
{
|
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|
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|
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|
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|
||||||
|
{
|
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|
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|
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|
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|
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|
{
|
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|
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|
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
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|
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{
|
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|
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|
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|
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{
|
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|
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|
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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|
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|
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{
|
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|
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|
||||||
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|
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{
|
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|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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|
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{
|
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|
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|
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|
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File diff suppressed because it is too large
Load Diff
@ -1,288 +0,0 @@
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update=Thu 10 Jun 2021 10:17:33 PM CEST
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|
|
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|
|
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|
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|
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|
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|
|
||||||
Enabled=1
|
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||||||
[pcbnew/Layer.Cmts.User]
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Enabled=1
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||||||
[pcbnew/Layer.Eco1.User]
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||||||
Enabled=1
|
|
||||||
[pcbnew/Layer.Eco2.User]
|
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||||||
Enabled=1
|
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||||||
[pcbnew/Layer.Edge.Cuts]
|
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||||||
Enabled=1
|
|
||||||
[pcbnew/Layer.Margin]
|
|
||||||
Enabled=1
|
|
||||||
[pcbnew/Layer.B.CrtYd]
|
|
||||||
Enabled=1
|
|
||||||
[pcbnew/Layer.F.CrtYd]
|
|
||||||
Enabled=1
|
|
||||||
[pcbnew/Layer.B.Fab]
|
|
||||||
Enabled=1
|
|
||||||
[pcbnew/Layer.F.Fab]
|
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||||||
Enabled=1
|
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||||||
[pcbnew/Layer.Rescue]
|
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||||||
Enabled=0
|
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||||||
[pcbnew/Netclasses]
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||||||
[pcbnew/Netclasses/Default]
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||||||
Name=Default
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|
||||||
Clearance=0.2
|
|
||||||
TrackWidth=1.2
|
|
||||||
ViaDiameter=0.8
|
|
||||||
ViaDrill=0.4
|
|
||||||
uViaDiameter=0.3
|
|
||||||
uViaDrill=0.1
|
|
||||||
dPairWidth=0.2
|
|
||||||
dPairGap=0.25
|
|
||||||
dPairViaGap=0.25
|
|
||||||
[pcbnew/Netclasses/1]
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||||||
Name=5V
|
|
||||||
Clearance=0.2
|
|
||||||
TrackWidth=1.4
|
|
||||||
ViaDiameter=0.8
|
|
||||||
ViaDrill=0.4
|
|
||||||
uViaDiameter=0.3
|
|
||||||
uViaDrill=0.1
|
|
||||||
dPairWidth=0.2
|
|
||||||
dPairGap=0.25
|
|
||||||
dPairViaGap=0.25
|
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||||||
[pcbnew/Netclasses/2]
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||||||
Name=Mini
|
|
||||||
Clearance=0.2
|
|
||||||
TrackWidth=1
|
|
||||||
ViaDiameter=0.8
|
|
||||||
ViaDrill=0.4
|
|
||||||
uViaDiameter=0.3
|
|
||||||
uViaDrill=0.1
|
|
||||||
dPairWidth=0.2
|
|
||||||
dPairGap=0.25
|
|
||||||
dPairViaGap=0.25
|
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||||||
[pcbnew/Netclasses/3]
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|
||||||
Name=Power
|
|
||||||
Clearance=0.2
|
|
||||||
TrackWidth=1.7
|
|
||||||
ViaDiameter=0.8
|
|
||||||
ViaDrill=0.4
|
|
||||||
uViaDiameter=0.3
|
|
||||||
uViaDrill=0.1
|
|
||||||
dPairWidth=0.2
|
|
||||||
dPairGap=0.25
|
|
||||||
dPairViaGap=0.25
|
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BIN
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